数字电路系统设计自动化-实验讲义(6)

数字电路系统设计自动化-实验讲义

的“Untitled - Graphic Editor” 原理图编辑窗，如图1-2。 3、调入元件

在图1-2所示图形编辑区单击鼠标右键，选择弹出菜单中的“Enter Symbol”即出现如图1-3所示的“Enter Symbol”对话框。在“symbol Name”对话框中输入元件号符名，可直

接输入所需元件。也可以从有关元件库中选择，如图1-3所示。 4、连接电路图

将所有元件调入工作区，调整好元件位置，并按原理图连接好电路，如图4所示。连接时将鼠标的箭头指向要连接的元件脚端，当箭头变为十字时按下鼠标左键并拖到要连接的另一元件脚，此时松开左键，即可将元件连上。 5、保存电路

电路连接好并检查无误后，即可将电路保存到设定的E:\myproject目录下。注意文件名不能用中文，并且要注意文件的扩展名，此处为.gdf。 二）、设定为当前工程

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为了使Max+plusII能对输入的设计项目按设计者的要求进行各项处理，在编译/综合之前，需要设置此文件为顶层文件（最上层文件），或称当前工程文件：Project，或者说将此项设计设置成工程。

选择菜单“File” Project “Set Project to Current File”，当前的设计工程即被指定为Project。也可以通过选“File” “Project” “Name”，在跳出的“Project Name”窗中指定E:\myproject下的D2.gdf为当前的工程。设定后可以看见MAX+plusII主窗左上方（图1－4）的工程项目路径指向为：“e:\myproject\d2.gdf”。这个路径指向很重要！

如果设计项目由多个设计文件组成，则应该将它们的主文件，即顶层文件设置成Project。如果要对其中某一底层文件进行单独编译、仿真和测试，也必须首先将其设置成Projcet。

为了获得与目标器件对应的，精确的时序仿真文件，在对文件编译前必须选定最后实现本设计项目的目标器件，在Max+plusII环境中主要选Altera公司的FPGA或CPLD。在设定工程文件后，应该选择用于编程的目标芯片：选择菜单“Assign”

“Device ”，在弹出的对话框中的“Device Family”下拉栏中，例如选择FLEX10K，此窗口（图1－5）的

Device Family是器件序列栏，应该首先在此栏中选定目标器件对应的序列名，如FLEX10K对应的是EPF10K10LC84－4系列。为了选择EPF10K10LC84－4

器

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件，应将此栏下方标有Show only Fastest Speed Grades的勾消去，以便显示出所有速度级别的器件。完成器件选择后，按OK键。

在设计中，设定某项设计为工程应该注意以下3方面的问题：

1、如果设计项目由多个.gdf文件组成，应先对各低层次文件（元件），如或门或半加器分别进行编辑、设置成工程、编译、综合、乃至仿真测试并存盘后以备后用。

2、最后将定顶层文件（存在同一目录中）设置为工程，统一处理，这时顶层文件可根据例化语句自动调用底层设计文件。

3、在设定顶层文件为工程后，底层设计文件原来设定的元件型号和引脚锁定信息自动失效。元件型号的选定和引脚锁定情况始终以工程文件（顶层文件）的设定为准。同样，仿真结果也是针对工程文件的。所以在对最后的顶层文件处理时，仍然应该对它重新设定元件型号和引脚锁定（引脚锁定只有在最后硬件测试时才是必须的）。如果需要对特定的底层文件（元件）进行仿真，只能将某底层文件（元件）暂时设定为工程，进行功能测试或时序仿真。 三）、编译和排错

选菜单“MAX+plus II” “Compiler”菜单（图1－6），在按“START”键运行编译前，还需要作一件事，即在进入编辑窗（图1－6），选择Processing项，选“Fitter Setting”，进入如图1－7的窗口，消去最上的“Quartus Fitter…”的勾。

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