八位RISCCPU设计和实现

八位RISCCPU设计和实现

委纠犬学

硕士学位论文

（２００６届）

八位ＲＩＳＣ—ＣＰＵ设计和实现

ＴｈｅＤｅｓｉｇｎｏｆ８ｂｉｔｓＰ，／ＳＣ—ＣＰＵ

研究生姓名竖羞——

通信与信息系兢

集成电＿路设计

２Ｄ０６年５月指导教师姓名——至堕塑董塾蔓专业名称研究方向论文提交Ｅｌ期

八位RISCCPU设计和实现

八位ＲＩＳＣ－ＣＰＵ设计和实现中文摘要

八位ＲＩＳＣ．ＣＰＵ设计和实现

中文摘要

本设计选题是基于与企业的一个合作项目，项目名称是“集成电路设计工程师入职培训”课程建设，主要工作是以ＲＩＳＣ－ＣＰＵ为实例，开发一个集成电路设计流程。

ＲＩＳＣ即精简指令集计算机（ＲｅｄｕｃｅｄＩｎｓｔｒｕｃｔｉｏｎＳｅｔＣｏｍｐｕｔｅｒ）的缩写。ＲＩＳＣ与一般的ＣＰＵ相比不仅只是简化了指令系统，而且是通过简化指令系统使计算机的结构更加简单合理，从而提高了运算速度。

本文对ＲＩＳＣ．ＣＰＵ的架构进行了探讨，介绍了如何设计ＲＩＳＣ－ＣＰＵ，并且立足于八位的ＲＩＳＣ．ＣＰＵ设计实例，以多种ＥＤＡ工具——Ｃａｄｅｎｃｅ公司的ＮＣ－Ｖｅｒｉｌｏｇ仿真工具，Ｓｙｎｏｐｓｙｓ公司的ＤｅｓｉｇｎＣｏｍｐｉｌｅｒ逻辑综合工具，Ｃａｄｅｎｃｅ公司的ＳＯＣＥｎｃｏｕｎｔｅｒ布局布线工具，Ｍｅｎｔｏｒ公司的Ｃａｌｉｂｒｅ版图验证工具协同设计，系统而全面地介绍了砌ｓｃ＿ＣＰｕ设计实例从模块划分、设计输入、功能仿真、逻辑综合、时序仿真、布局布线到版图验证等各环节的流程和方法。同时本文在设计中采用了低功耗和探讨了流水线设计方法，使电路的性能更加完善。

关键词：ＲＩＳＣ．ＣＰＵ、功能仿真、时序仿真、逻辑综合、布局布线、版图验证

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作者：陈芳指导老师：王明湘黄秋萍

八位RISCCPU设计和实现

ＴｈｅＤｅｓｉｇｎｏｆ８ｂｉｔｓＲＩＳＣ－ＣＰＵ

Ａｂｓｔｒａｃｔ

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ＷｒｉｔｔｅｎｂｙＦａｎｇＣｈｅｎ

ＳｕｐｅｒｖｉｓｅｄｂｙＭｉｎｇｘｉａｎｇＷａｎｇ，ＱｉｕｐｉｎｇＨｕａｎｇⅡ

八位RISCCPU设计和实现

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