PS2接口协议解析及应用

2.2 电气特性

ps/2 通讯协议是一种双向同步串行通讯协议。通讯的两端通过Clock(时钟脚)同步，并通过DATA(数据脚)交换数据。任何一方如果想抑制另外一方通讯时，只需要把Clock(时钟脚)拉到低电平。如果是pc机和ps/2键盘间的通讯，则pc机必须做主机，也就是说，pc机可以抑制ps/2键盘发送数据，而 ps/2键盘则不会抑制pc机发送数据。一般两设备间传输数据的最大时钟频率是33kHz，大多数ps/2设备工作在10~20kHz。推荐值在 15kHz左右，也就是说，Clock(时钟脚)高、低电平的持续时间都为40μs。每一数据帧包含11~12个位，具体含义如表1所列。

表1 数据帧格式说明

1个起始位 总是逻辑0

8个数据位 （LSB）低位在前

1个奇偶校验位 奇校验

1个停止位 总是逻辑1

1个应答位 仅用在主机对设备的通讯中

表中，如果数据位中1的个数为偶数，校验位就为1；如果数据位中1的个数为奇数，校验位就为0；总之，数据位中1的个数加上校验位中1的个数总为奇数，因此总进行奇校验。

2.3 ps/2设备和pc机的通讯

ps/2 设备的Clock(时钟脚)和DATA(数据脚) 都是集电极开路的，平时都是高电平。当ps/2设备等待发送数据时，它首先检查Clock(时钟脚)以确认其是否为高电平。如果是低电平，则认为是pc机抑制了通讯，此时它必须缓冲需要发送的数据直到重新获得总线的控制权(一般ps/2键盘有16个字节的缓冲区，而ps/2鼠标只有一个缓冲区仅存储最后一个要发送的数据)。如果Clock(时钟脚)为高电平，ps/2设备便开始将数据发送到pc机。一般都是由ps/2设备产生时钟信号。发送时一般都是按照数据帧格式顺序发送。其中数据位在Clock(时钟脚)为高电平时准备好，在Clock(时钟脚)的下降沿被pc机读入。ps/2设备到pc机的通讯时序如图2所示。

当时钟频率为15kHz时，从Clock(时钟脚)的上升沿到数据位转变时间至少要5μｓ。数据变化到Clock(时钟脚)下降沿的时间至少也有5 μｓ，但不能大于25 μｓ，这是由ps/2通讯协议的时序规定的。如果时钟频率是其它值，参数的内容应稍作调整。

上述讨论中传输的数据是指对特定键盘的编码或者对特定命令的编码。一般采用第二套扫描码集所规定的码值来编码。其中键盘码分为通码(make)和断码 (Break)。通码是按键